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楼主: hudie2002

VHDL还有前途吗?

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发表于 2010-4-1 23:22:14 | 显示全部楼层
我现在也在用VHDL  感觉VHDL语法要求比较苛刻~~~  至于有没有前途,这个我也不大清楚啊 呵呵
发表于 2010-4-2 07:58:05 | 显示全部楼层
其实,两种之中能够熟练掌握其中一种,绝对有用!
发表于 2010-4-2 17:40:35 | 显示全部楼层
语言只是一种工具
发表于 2010-4-6 23:29:31 | 显示全部楼层
主要是数字电路设计的思想掌握了,就算不会erilog和vhdl,只会用与非门和D触发器,一样是牛人。
发表于 2010-4-7 10:45:45 | 显示全部楼层
有前途 很多机构在用
发表于 2010-4-7 21:16:15 | 显示全部楼层
国内还是verilog居多吧,反正我不懂VHDL。
发表于 2010-4-9 09:14:25 | 显示全部楼层
关注中 !!!!111
发表于 2010-4-9 09:41:53 | 显示全部楼层
需要社么就用什么呗  会的多了总没错  哈哈
发表于 2010-4-9 11:11:12 | 显示全部楼层
绝对有前途,我感觉它挺好的。主要是语法严谨。


相比之下,Verilog语法自由。各有各的优势。


VHDL 适合多人合作的大项目。


1# hudie2002
发表于 2010-4-9 11:12:38 | 显示全部楼层
呵呵,各有各的优缺点。你以为是秦始皇啊。统一六国了就统一使用小篆...

9# woodhorse
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