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[资料] SystemVerilog Testbench lab培训文档及代码

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发表于 2018-8-23 01:44:29 | 显示全部楼层 |阅读模式

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本帖最后由 yuquan216 于 2022-3-26 12:07 编辑

需要学习systemverilog的可以看看,里面有6个lab可用于学习,代码和文档都有,由于文档被限制大小,故上传到网盘
文档路径:链接:https://pan.baidu.com/s/1CZVfR860dLoCcm6Y4LSpBw
提取码:6b94

cn_ces_svtb_2011.12.tar

290 KB, 下载次数: 537 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2018-8-24 16:10:19 | 显示全部楼层
谢谢了!!!!
发表于 2018-8-24 20:52:08 | 显示全部楼层
thanks
发表于 2018-8-25 22:03:03 | 显示全部楼层
回复 1# yuquan216


    Thanks
发表于 2018-8-26 05:51:00 | 显示全部楼层
Thanks
发表于 2018-9-1 10:26:26 | 显示全部楼层
看看。。。。。。。。。。。。。。。
发表于 2018-9-1 21:25:03 | 显示全部楼层
发表于 2018-9-1 22:23:54 | 显示全部楼层
发表于 2018-9-2 04:14:36 | 显示全部楼层
thanks for your sharing
发表于 2018-9-8 19:37:06 | 显示全部楼层
回复 1# yuquan216


   好人
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