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楼主: yuquan216

[资料] SystemVerilog Testbench lab培训文档及代码

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发表于 2021-9-11 00:50:19 | 显示全部楼层
没有文档,亲测
发表于 2021-9-14 10:58:42 | 显示全部楼层
感谢分享。
发表于 2021-10-2 16:03:46 | 显示全部楼层
谢谢分享 。。。。
发表于 2021-10-2 16:59:10 | 显示全部楼层
thanks
发表于 2021-11-4 14:49:13 | 显示全部楼层
没有文档啊
发表于 2022-1-7 00:12:57 | 显示全部楼层
谢谢分享
 楼主| 发表于 2022-3-26 11:54:07 | 显示全部楼层


aixuexidewa 发表于 2020-3-1 18:52
这里面有文档??


不好意思,现在才看到,文档补上
发表于 2022-3-27 08:30:51 | 显示全部楼层
看着很不错 谢谢分享
发表于 2022-3-30 09:22:08 | 显示全部楼层
goooooooood
发表于 2022-3-30 10:31:20 | 显示全部楼层
看了下,是synopsys的lab源码和帮助文档,不错不错~谢谢楼主分享
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