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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC资料区 › GPIO接口的verilog IP
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楼主: helimpopo

[资料] GPIO接口的verilog IP

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syf1025
发表于 2022-7-7 21:46:55 | 显示全部楼层
谢谢
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zhuxi522
发表于 2022-8-10 10:32:57 | 显示全部楼层
谢谢
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chengwei1996
发表于 2022-10-10 13:37:43 | 显示全部楼层
谢谢分享！
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五柠檬
发表于 2022-11-17 09:40:50 | 显示全部楼层
谢谢分享！
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dmf336
发表于 2023-2-16 17:34:15 | 显示全部楼层


多谢分享
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wangli_peking
发表于 2023-2-17 20:21:18 | 显示全部楼层
看看
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badegg3
发表于 2023-5-26 10:25:27 | 显示全部楼层
thanks for your sharing
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vinodlk123
发表于 2023-6-9 13:44:23 | 显示全部楼层
Thank you ..
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cxa
发表于 2024-3-15 18:01:57 | 显示全部楼层
使用总线接口，生成了GPIO控制线对应的o, oe, i，没啥用
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hclin
发表于 2024-3-16 20:29:07 | 显示全部楼层
值得參考，謝謝分享
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