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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC资料区 › GPIO接口的verilog IP
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楼主: helimpopo

[资料] GPIO接口的verilog IP

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gubels
发表于 2022-3-25 11:58:01 | 显示全部楼层
tnx for haring
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caojiangcheng
发表于 2022-3-25 14:42:14 | 显示全部楼层
看看
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sky9566701
发表于 2022-4-18 16:34:55 | 显示全部楼层
谢谢分享！
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zhanglin814725
发表于 2022-4-24 16:49:15 | 显示全部楼层
thanks for your sharing
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pqtel
发表于 2022-6-1 15:07:12 | 显示全部楼层
have a look.
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jarvis_min
发表于 2022-6-23 20:47:38 | 显示全部楼层
学习
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yshang83
发表于 2022-6-23 22:13:16 | 显示全部楼层
Thanks
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罗啸
发表于 2022-6-26 12:39:55 | 显示全部楼层
GPIO接口的verilog IP
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肇恒博
发表于 2022-6-27 11:49:03 | 显示全部楼层
就是opencores对gpio。。。。。
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hughs
发表于 2022-6-27 14:11:01 | 显示全部楼层
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