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查看: 2165|回复: 0

[求助] vivado BUFGMUX 使用请教

发表于 2016-8-10 13:30:08 | 显示全部楼层 |阅读模式

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现在工程有个问题，FPGA工程，xilinx ks系列1、系统主时钟mclk，自己写逻辑分频（counter计数）出clk_div，这种时钟分频，在FPGA可行吗？
2、mclk与clk_div 经过一个BUFGMUX二选一，这种用法可以吗？
欢迎大家讨论

BUFGMUX, fpga, 分频

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