verilog中符号数的问题

lhw123 · 发表于 2015-10-28 19:43:59

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比如我input定义了有符号数，然后我tb文件要输入负号，要输入的时候是需要输入数的补码来表示我输入的是负数？比如有符号数相乘，正数乘负数，我也需要输入补码才能相乘？

418478935 · 发表于 2015-10-28 20:45:15

是的，负数要输入其补码

南宫恨 · 发表于 2015-10-29 08:11:51

就直接-多少就可以，10进制

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