有人对systemverilog这种新的语言有研究么?

Caron · 发表于 2007-5-20 21:16:34

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感觉用的如何?考虑学一下...但是资料什么的比较少...
有大牛学过用过的介绍一下经验

幽谷寻风 · 发表于 2007-5-21 21:29:46

好像刚出了本书《systemverilog验证方法》

freelion · 发表于 2007-5-21 22:37:26

那本书太难懂了，建议先看SystemVerilog for verification，再看Systemverilog for testbench，最后再来看VMM，不过本人还是建议不要去学VMM，可以看AVM，SYNOPSYS公司的技术支持太差了

Caron · 发表于 2007-5-21 23:21:51

原帖由 freelion 于 2007-5-21 22:37 发表
那本书太难懂了，建议先看SystemVerilog for verification，再看Systemverilog for testbench，最后再来看VMM，不过本人还是建议不要去学VMM，可以看AVM，SYNOPSYS公司的技术支持太差了

大牛!!!
不过貌似SystemVerilog for verification和Systemverilog for testbench两本书都没找的卖的....
不知道哪里能买到这两本...