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[求助] 关于xilinx例化的DDR信号位宽的一些疑问

发表于 2015-7-31 15:52:59 | 显示全部楼层 |阅读模式

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我用xilinx例化了一个DDR控制器，用户接口的信号位宽一直算不对。比如app_af_addr[30:0]，但是bank_width, col_width和row_width加起来也没有31。这是为什么？

接口, 控制器, 用户

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发表于 2015-8-1 01:51:41 | 显示全部楼层

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