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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 基于Verilog的循环冗余校验_CRC_的实现
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楼主: largedeer

基于Verilog的循环冗余校验_CRC_的实现

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lhy555
发表于 2009-4-30 19:42:50 | 显示全部楼层
打 恶趣味额全部
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lhy555
发表于 2009-4-30 19:45:59 | 显示全部楼层
大大答复啊
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发表于 2009-6-27 21:51:05 | 显示全部楼层
good, thanks
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immypro
发表于 2009-7-1 10:10:11 | 显示全部楼层
下完再顶！！！！！！！
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jcchan
发表于 2009-7-1 12:49:09 | 显示全部楼层
Thanks!!!
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发表于 2009-9-7 15:25:45 | 显示全部楼层
Thanks & Great!!
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lwwlww
发表于 2009-9-25 10:12:53 | 显示全部楼层
多谢分享！！！！！！！！！
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icwing
发表于 2009-11-13 11:18:50 | 显示全部楼层
xuexixuexi!!
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chenfj1
发表于 2009-11-13 22:33:56 | 显示全部楼层
谢谢楼主分享
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发表于 2010-1-16 16:21:28 | 显示全部楼层
good, thanks.
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