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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › system verilog 超级资料（中文）

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楼主: ise

system verilog 超级资料（中文）

发表于 2008-6-19 09:53:19 | 显示全部楼层

thanks for sharing!!

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发表于 2008-6-19 09:55:54 | 显示全部楼层

谢谢谢谢谢谢谢谢

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发表于 2008-6-19 10:32:06 | 显示全部楼层

谢谢谢谢谢谢谢谢

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发表于 2008-6-24 14:11:12 | 显示全部楼层

beging to learning sv, thanks!

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发表于 2008-6-28 20:47:23 | 显示全部楼层

谢谢！

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发表于 2008-6-29 05:38:12 | 显示全部楼层

Thanks for sharing

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发表于 2008-6-29 05:47:29 | 显示全部楼层

Thanks for sharing

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发表于 2008-6-29 10:52:05 | 显示全部楼层

xiexie

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发表于 2008-7-4 11:58:34 | 显示全部楼层

不错，先看看。

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发表于 2008-7-10 11:29:46 | 显示全部楼层

THANK YOU!!!

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