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[求助] min pulse width违例 如何修【已解决】

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发表于 2015-4-7 13:40:41 | 显示全部楼层 |阅读模式

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本帖最后由 jiazhang 于 2015-4-8 09:11 编辑

cts之后出现 min pulse width的违例, 用命令检查transtion,没有错误
icc_shell> report_clock_tree -drc_violators
****************************************
Report : clock tree
Design : demo00_top
Scenario(s): func_wcl_cmax
Version: H-2013.03-ICC
Date   : Tue Apr  7 13:45:02 2015
****************************************
============================Report for scenario (func_wcl_cmax)=============================
Warning: Float pin scale factor is not set for the 'max' operating condition of scenario 'func_wcl_cmax'.  Skews may be inaccurate. (CTS-376)
------------------------------------------------------
DRC violations on clock tree
Clock Tree Name                   : clk
Scenario Name                     : func_wcl_cmax
Clock Root Pin                    : clock
------------------------------------------------------
Number of MaxTran Violators       : 0
Number of MaxCap Violators        : 0
Number of MaxFanout Violators     : 0


查看layout,看到之前设置的buf,inv也都在clock path上,

时钟周期是3ns

请问这个该如何解决呢?
 楼主| 发表于 2015-4-7 13:41:32 | 显示全部楼层
33333.jpg
发表于 2015-4-7 13:47:52 | 显示全部楼层
通常不用修, 因为.lib 里面的min pulse是很小的一个值,即memory能工作的最小允许的clock period值,
比如1Ghz 或几百Mhz, 而设计里面通常不需要这么快
 楼主| 发表于 2015-4-7 13:59:13 | 显示全部楼层
回复 3# icfbicfb
版大,lib里的是很小,但我这个跑完之后,需要的更小啊,要不应该就不会违例了吧! 我的是3ns也有300MHz;

这个违例是不是说:比如我的库允许我只能跑100MHz,但我硬要跑300MHz,所以出现了违例;


我看PT guide上说,如果有这个违例,可能会允许逻辑错误的;这个就直接过去,不用修吗?
 楼主| 发表于 2015-4-7 14:02:15 | 显示全部楼层
回复 3# icfbicfb
33333.jpg
 楼主| 发表于 2015-4-7 14:09:53 | 显示全部楼层
回复 3# icfbicfb

版大,我用report_min_pulse_width报了下,确实lib中stand cell的min pulse width都很小,但latch的比较大,而这里的违例也正是latch的;

                      Required      Actual
  Pin                pulse width   pulse width   Slack           Scenario
--------------------------------------------------------------------------------
  clk_gate_DataOut_reg/latch/CLK(low)
                      2.41          1.99         -0.42 (VIOLATED)
                                                                 func_wc_cmax
  MEM_Data_reg_13__0_/CLK(low)
                      0.41          1.98          1.57 (MET)     func_wc_cmax
  DataOut_reg_2_/CLK(low)
                      0.41          2.00          1.59 (MET)     func_wc_cmax
  DataOut_reg_3_/CLK(low)
                      0.41          2.00          1.59 (MET)     func_wc_cmax
  DataOut_reg_6_/CLK(low)
                      0.41          2.00          1.59 (MET)     func_wc_cmax
发表于 2015-4-7 18:02:28 | 显示全部楼层
latch是icg吧,自然有clock gating check来保证的

我印象中没有修过min pulse width的问题的
发表于 2015-4-7 18:02:31 | 显示全部楼层
latch是icg吧,自然有clock gating check来保证的

我印象中没有修过min pulse width的问题的
 楼主| 发表于 2015-4-7 19:05:37 | 显示全部楼层
回复 8# icfbicfb
恩 是icg;就是担心片子出来之后 不能工作
发表于 2015-4-8 09:51:06 | 显示全部楼层
我觉得不会, 只要其他timing clean就行
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