做DC综合后仿真时，发现关键信号被综合优化掉了

最酒店 · 发表于 2015-4-1 10:19:14

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如题，在Modelsim中做后仿真，发现结果不对，结果发现关键信号不见了，出现这种情况，综合的约束只是简单的对时钟、输入输出延时、transition做了约束，请问各位大牛，这种情况该怎么处理？？

jun_dahai · 发表于 2015-4-1 12:01:11

布局布线完成后，先进行形式验证，以确保前后功能一致

wgej1987 · 发表于 2015-4-1 15:10:40

工具优化你大多情况就是你这个地方是可以优化的。所以出错原因可能不在这里

whywwhhyy · 发表于 2015-4-1 16:25:10

优化只会优化掉对输出无影响的信号

[求助] 做DC综合后仿真时，发现关键信号被综合优化掉了