implicit exclude pins

豆沙包 · 发表于 2015-3-25 15:00:58

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本帖最后由豆沙包于 2015-3-26 09:26 编辑

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如上图所示，IMAGE_inst_clk_div_4_reg的Q端接到下一个SDFF寄存器的reg端口。在做CTS的时候，会将这个存储器的SI端口认为是 implicit exclude pins,这样在时钟树综合之后，这条路径上的latency会计算到SI端口前插入的CLKBUF/A端口，导致和另一路径上的latency出现了很大的skew。
想问一下，这一点应该定义为什么？stiop_pin还是floating_pins?还是应该更改输出时钟点（现在分频后的时候总定义在IMAGE_inst_clk_div_4_reg/Q处）？