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查看: 8876|回复: 20

[求助] PLL相噪仿真中PSS的设置问题

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发表于 2015-1-22 15:31:39 | 显示全部楼层 |阅读模式

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VCO用verilog-A的模型,PFD/CP/LPF用晶体管级电路,做PSS/PNOISE仿真,在PSS设置中总有参考频率源那个信号,beat frequency就没法设置为输出频率,各位大侠有用过这种方法吗?咋解决的?
 楼主| 发表于 2015-1-22 16:31:27 | 显示全部楼层
自己顶个
发表于 2015-1-22 17:22:47 | 显示全部楼层
我一般都是VCO和PFD/CP分开做PN分析。
 楼主| 发表于 2015-1-22 17:29:17 | 显示全部楼层
回复 3# zy_gu@163.com


   然后再用matlab相加一下,对吗?我其实就是想用spectre直接仿出PN
发表于 2015-1-22 17:43:17 | 显示全部楼层
是。

你考虑过VCO和PFD/CP一起仿,在设边带的时候,是absolute,还是relative?
 楼主| 发表于 2015-1-22 17:44:39 | 显示全部楼层
回复 5# zy_gu@163.com

这确实是个问题呀
发表于 2015-1-22 17:48:09 | 显示全部楼层
所以我分开仿,
发表于 2015-1-22 18:08:26 | 显示全部楼层
回复 1# greatdilly


   仿真整个PLL应该收敛不了吧。
 楼主| 发表于 2015-1-25 21:12:43 | 显示全部楼层
回复 7# zy_gu@163.com

请问一下,PFD/CP/LPF的绝对噪声是怎样转化为相位噪声那样的相对值的?
发表于 2015-1-25 21:28:00 | 显示全部楼层
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