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[求助] set_clock_groups 疑问?

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发表于 2014-12-20 20:41:24 | 显示全部楼层 |阅读模式

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问题:一个2选1的Mux,A,B输入端口为CLKA,CLKB,输出C为CLKC,        1)通过create_clock定义了CLKA,CLKB。
        2)set_clock_groups -logically_exclusive -group CLKA -group CLKB,定义这两时钟在逻辑上互斥,目的想让CLKA,CLKB分别进行时序分析。
        但是实际上,DC只用最近定义的CLK分析了时序路径。例如,先用create_clock定义了CLKA,再定义了CLKB,那么DC会用CLKB分析时序,而不会用CLKA。如果先定义了CLKB,后定义了CLKA,那么DC则会用CLKA来分析时序路径。这是为什么?为什么两个时钟都不分析?
 楼主| 发表于 2014-12-20 22:49:22 | 显示全部楼层
set timing_enable_multiple_clocks_per_reg true,CLKA,CLKB便可分别进行时序分析。
发表于 2014-12-21 01:09:44 | 显示全部楼层
谢谢啦,还没有用过这个命令
发表于 2014-12-22 10:15:56 | 显示全部楼层
学习了,~~~
发表于 2016-8-31 17:05:48 | 显示全部楼层
学些了~~
发表于 2016-8-31 19:50:41 | 显示全部楼层
发表于 2016-12-6 14:40:11 | 显示全部楼层
我看过Xilinx官方给的解决方案,应该是physically exclusive。你试一下,估计logically exclusive不行的
发表于 2016-12-6 19:39:57 | 显示全部楼层
学习了
发表于 2022-9-28 15:41:08 | 显示全部楼层


fwfjndx 发表于 2016-12-6 14:40
我看过Xilinx官方给的解决方案,应该是physically exclusive。你试一下,估计logically exclusive不行的 ...


怎么可能是physical exclusive...
楼主这种情况可以试一下给A B分别generate clock,然后set group logically exclusive
发表于 2023-3-2 17:29:15 | 显示全部楼层
学习了
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