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shijingyao1990 · 发表于 2014-12-13 12:53:52

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本帖最后由 shijingyao1990 于 2014-12-13 12:55 编辑

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上面那个图是我们project要求,我已经做了一个带隙基准电压1.10V左右,但是电源电压只有1.3V,那按照下面的topology,运算放大器输出电平也就在0.3-1V之间,那这个MOS管子不就截止了吗,求高手指点.

mpig09 · 发表于 2014-12-13 21:01:40

Hi shijingyao1990:

Could you use PMOS for IOUT or reduce the Vref voltage?

Thanks.
mpig

GodofSun · 发表于 2014-12-13 22:12:41

这种架构，电源1.3V，Vref用1.1V肯定不合适啊，原因你自己都说出来了，那解法应该就有了。。。

残桥挂月 · 发表于 2014-12-13 22:34:20

如果把NMOS换成PMOS呢

mouseyyh · 发表于 2014-12-17 16:50:36

good luck

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