急求，关于PLL的配置

梦孤城 · 发表于 2016-8-27 20:52:09

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急，求助，配置NIOS II 的PLL时，一直有这个错误Error: pll_0: 100.0 MHz is illegal reference clock frequency。
{EK(O3)I29UVCWGB120@P.jpg

请问这个这么解决，并且需要倍频，需要怎么设置多个时钟，谢谢！

sme-ic · 发表于 2016-8-28 20:03:44

输入频率不对啊，不是写得很清楚了吗，应该是你的这个频率不在器件规定的范围之内。

查一下你FPGA的datasheet。

梦孤城 · 发表于 2016-8-29 22:27:03

回复 2# sme-ic 已经处理好了，谢谢！

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