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[讨论] 关于状态机编写风格的一些疑问

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发表于 2014-12-5 05:47:45 | 显示全部楼层 |阅读模式

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不论是Moore Machine还是Mealy Machine,都是有两个寄存器的,一个是当前状态(state),另一个是下一状态(nextstate)。
那么写Verilog代码的时候,可不可以直接用一个state呢?比如如下代码,这么写仿真能跑通,但是有什么问题吗?(这么写挺方便的啊)




  1. always @(posedge Clk)
  2.      begin
  3.      if(Rst)
  4.        begin
  5.          state <= 0;
  6.        end  
  7.      else  
  8.       case(state)
  9.        3'b000:        // To initialize Vmem, Calcium, EP, EN, IP, IN and counters
  10.         begin
  11.           do something
  12.           state <= 3'b001;
  13.         end
  14.        3'b001:            // Inherent leakages of Vmem, EP, EN, IP, IN, C of this particular neuron
  15.         begin
  16.           state <= 3'b010;
  17.           do something
  18.         end
  19.        3'b010:                   // iterate 135 times to accumulate EP, EN and IP and IN
  20.         begin
  21.           if(cnt==135)
  22.             begin
  23.               cnt <= 1;
  24.               state <= 3'b011;
  25.             end
  26.           else
  27.             cnt <= cnt + 1;
  28.           cnt_lsm <= 1;
  29.           do something
  30.         end
  31.        3'b011:                        // Finalize the membrane potential Vmem
  32.         begin
  33.             state <= 3'b100;
  34.             do something
  35.         end
  36.        ......
  37.      endcase
  38.      end   


复制代码
发表于 2014-12-5 08:41:14 | 显示全部楼层
Mark下,关注大神回答
发表于 2014-12-5 08:47:51 | 显示全部楼层
这么写也是可以的,功能一样的。你可以综合成电路看看,综合出来的应该是一样的。我们公司有的代码就是这么写的。
发表于 2014-12-5 23:08:06 | 显示全部楼层
都说三段式状态机好,我个人还是喜欢二段式状态机的风格,不区分state 和 next_state
发表于 2014-12-7 10:50:13 | 显示全部楼层
这里仅仅是编码风格的问题,没有什么问题。,一段式的你也放心使用吧!
发表于 2014-12-7 19:07:21 | 显示全部楼层
状态机的next state在状态转移图中的概念,不不意味着在一个状态机中存在两个状太寄存
发表于 2014-12-9 12:55:23 | 显示全部楼层
学习~~~~~
发表于 2014-12-10 17:06:25 | 显示全部楼层
学习中~~~~
发表于 2014-12-14 20:44:23 | 显示全部楼层
我也觉得用一个状态,两段式好一些;状态转移和输出分开,一目了然
发表于 2015-11-10 21:07:08 | 显示全部楼层
学习下~
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