关于systemverilog学习困惑

goodideaooo · 发表于 2014-4-23 22:56:12

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请各位大神指点一下迷茫期的我。~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~
自己学习systemverilog有段时间了，一直看systemverilog语法但是没有实践练习，感觉没什么效果，之前看过得东西又还回去了。
求各位大神指点迷津，怎样去实践练习，把看的东西运用下，变成自己的东西？？？（例如：怎样去用sv搭建一些测试平台什么的？）