在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 7227|回复: 16

[求助] 怎么实现sealring和core隔离

[复制链接]
发表于 2014-3-6 17:54:11 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
请问各位大侠,怎么实现sealring和chip core隔离?
比如用深阱把sealring和chip core 隔离, 或者把sealring做到深阱里面?

或者用其他的方法来隔离?

如做过相关工作的还请指点下!  谢谢
发表于 2014-3-7 12:24:08 | 显示全部楼层
这得看你的工艺啊,根据工艺分析。
 楼主| 发表于 2014-3-7 17:13:53 | 显示全部楼层
RF工艺。  或者标准coms 工艺   。  能做吗? 还请指教!  谢谢~!
 楼主| 发表于 2014-3-10 14:26:28 | 显示全部楼层
要石沉大海了吗?
发表于 2014-3-10 15:15:25 | 显示全部楼层
你design rule叫你咋做你就咋做。
发表于 2014-3-11 09:40:10 | 显示全部楼层
请问各位大侠,怎么实现sealring和chip core隔离?
看不太懂問題

確定是sealring嗎
 楼主| 发表于 2014-3-11 11:55:20 | 显示全部楼层
就是 假如说 是bonding的时候一根bonding线跟sealring短接了 对于整个chip也没有影响,所有要达到这个目的就一定要让sealring跟 chip core 隔离才好?
发表于 2014-3-11 15:55:20 | 显示全部楼层

  楼主说的这种情况 bongding的人员付全部责任    sealring一般都接GND的嘛
 楼主| 发表于 2014-3-14 09:11:05 | 显示全部楼层
回复 8# LDJK

   是,   一般是像你说的这样,但如果有特殊要求的话,还是特殊处理的。像上面提的要求的话,能简单的用DNW隔离吗?
发表于 2014-3-14 10:33:01 | 显示全部楼层
以我的经验,一般隔离的话就是加阱环和衬底环,数量和宽度随要求调整。但是我做过的版图都没做过这方面的处理。如果有deep nwell这一层,chip core都会放在deep nwell里了,sealring是画在直接放在衬底上的,根据design rule要求,它们之间的距离也很可观了,基本也没什么相互干扰了吧?需要隔离吗?以前用过一次HHNEC的工艺,它要求IO和内部结构之间有个隔离结构,也就是加最小宽度是3um(印象中好像是哈)的两圈隔离环。其他我用过的工艺还真么见过类似的要求
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-12-3 08:30 , Processed in 0.027086 second(s), 8 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表