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[求助] 求教SpectreVerilog混合信号仿真SDF的设置问题

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happyboy1479
发表于 2013-11-19 23:00:13 | 显示全部楼层 |阅读模式

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本帖最后由 happyboy1479 于 2013-11-19 23:06 编辑

2.jpg 1.jpg

在ADE中simulation的option选项的Mix Signal选项，这个Scope应该怎么填？还有就是Config怎么填写才对。

顺便问下，VCS中使能负值时序检查的参数是+neg_tchk，对应Verilog-XL里面是什么指令？求大神指导！
SDF, 混合信号仿真, 设置

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