ise中mig ip core的使用

441lujing · 发表于 2013-9-23 11:14:05

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我有大量的数据想要存在DDR3中，用mig来控制。生成了IP核，在用仿真example_design中的sim_tb_top模块时，却得不到有效信号出来（只有时钟信号有，其他信号都是不确定信号，就像下面的图。）不知道是不是我哪块地方没设置好呢，还是。。求各位大神帮忙。分享下你们设计mig的经验

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adrian7 · 发表于 2013-9-23 15:35:26

图呢？

441lujing · 发表于 2013-9-23 15:57:37

图片无法上传，但是还是像描述的那样，phy_init_done这个信号一直是低电平

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