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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › verilogA model for PLL

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楼主: peterlin2010

[资料] verilogA model for PLL

发表于 2018-12-17 11:13:41 | 显示全部楼层

thank you I need it!!

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发表于 2019-1-2 22:43:33 | 显示全部楼层

thanks

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发表于 2019-1-3 12:45:32 | 显示全部楼层

谢谢分享

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发表于 2019-1-29 14:33:53 | 显示全部楼层

谢谢~~

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发表于 2019-2-28 13:49:18 | 显示全部楼层

很有参考价值，谢谢楼主！

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发表于 2019-2-28 13:51:23 | 显示全部楼层

学习一下！

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发表于 2019-3-16 16:48:51 | 显示全部楼层

thanks

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发表于 2019-6-8 14:56:02 | 显示全部楼层

Thanks！

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发表于 2019-6-10 09:12:25 | 显示全部楼层

很不错哦！！

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发表于 2019-6-18 19:26:32 | 显示全部楼层

看看，感谢分享

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