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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › verilogA model for PLL
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楼主: peterlin2010

[资料] verilogA model for PLL

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发表于 2021-8-13 22:17:21 | 显示全部楼层
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发表于 2021-8-14 22:26:55 | 显示全部楼层
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发表于 2021-8-16 09:56:20 | 显示全部楼层
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发表于 2021-8-17 17:38:01 | 显示全部楼层
不错。
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cdting
发表于 2021-8-17 22:21:52 | 显示全部楼层
Thanks!!!
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发表于 2021-8-18 15:27:18 | 显示全部楼层
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发表于 2021-10-26 16:00:24 | 显示全部楼层
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发表于 2022-6-10 16:01:12 | 显示全部楼层

it is too good for me!!
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发表于 2022-6-11 00:10:13 | 显示全部楼层
谢谢啦！
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发表于 2023-3-29 15:47:15 | 显示全部楼层
good reference
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