【关于AMBA AXI 总线的专题讨论】

老扁

原帖由 bornforhappy 于 2009-9-18 11:48 发表

                               
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老扁，想请教一个问题，如果说multi-layer(是否就是AHB总线矩阵？)只是逻辑上有几个AHB叠加在一起，那么它和shared AHB bus结构有何区别？它又如何实现并行的主从访问？为什么我感觉多层的AHB结构应该是物理上的 ...

你的这张图要实现的是多个master可以并行同时对多个slave进行访问，以提高总线效率，其中matrix就是一种并行协调结构。比如他可以实现同时M1-S1，M2-S2之间的传输。。。而shared AHB bus结构是最原始的总线结构，它只允许总线上同时只有一个master和salve之间的传输，其他的设备就都在等待。

mcupro

AXI在某国产高性能处理器上使用。

xiaowei7001

原帖由 老扁 于 2009-9-18 16:00 发表

                               
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引用:原帖由 forxheng 于 2009-1-11 12:24 发表

                               
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关于AMBA 3.0_AXI协议的几点疑问，欢迎大虾赐教~~小弟最近在研究AMBA3.0协议，关于AXI有些疑问： 1. burst 方式中 ...

小弟也看了一段时间的AXI，我认为仲裁和译码都是在AXI总线里完成的，分别在总线的每个接收端的仲裁器和发送端的译码器完成的。请高手多多指教

娟g晖

6633.us花鳥利(花鳥レイ Rei Hanatori)acom

                               
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111ss 片瀬梨音(Rion Katase)111mmm

                               
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sao66 愛田由(あいだゆあ Yua Aida)sao30

                               
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5x555北原多香子VS555sss小林爱弓

                               
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97an kazuki a4y/a4u

                               
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不再回头

有个问题困扰很久，想请教下。
axi协议中有如下描述：
The read data reordering depth is the number of addresses pending in the slave that can be reordered.

1.这个read data reordering depth到底是个什么概念？它的目的只是为了address的pending么？还是还有其他用途？
2.Out-of-order这个功能跟这个read data reordering depth 有关么？
3.对于slave来说有没有outstanding的深度呢？
4.这个outstanding的深度跟read data reordering depth有什么关系么？
5.另外，如果pending在这个slave的address都是来自于同一个master，而且是同样的id，由于需要保证返回数据的顺序性，这个顺序是由slave本身来保证，还是说它通过read data reordering depth或类似的fifo来对slave ip返回的数据进行重排序再返回给总线呢？
谢谢！

hjj1123

回下ls的，乱序的深度当然是由slave决定的，你自己画一下读操作乱序的时序图就明白了。

大家讨论下，写操作的乱序由必要吗？都用在那些场合？如果是多slave的情况那么master怎么知道该先写哪个slave那？

countryhotel

最近在学习AXI与AHB，看了协议后，有部分疑问需要大家帮忙，
1 AXI Interconnect内是否有总裁器？Interconnect的作用？地址解码选择slave是否与AHB中相似？
2 AXI中的master与slave的互联方式是怎么样的？是一对一，还是M对N，若M对N的话，masteri是否可以对任意的slave进行通信？
3 Bufferable与catchable是什么？他们的作用？
4 privileged access与secure access是什么？他们的作用？
5 semaphore type operations具体指什么类型操作？
6 Byte-invariant看了协议一直没弄懂，最好是能举一个实际的例子？

myrrhy

68# countryhotel
照我的理解回答下
1 AXI Interconnect内是否有总裁器？Interconnect的作用？地址解码选择slave是否与AHB中相似？
     Interconnect功能就类似AHB里面的Arbitor.只不过它要做的事情更多，需要对接在它上面的每一个“Master-Slave Interface接口对”配置的不同，进行相应的数据匹配。每个端口配置不同，实现也不同。地址译码与AHB相似。
2 AXI中的master与slave的互联方式是怎么样的？是一对一，还是M对N，若M对N的话，masteri是否可以对任意的slave进行通信？
     M对N,只要系统指定能访问到的都可以访问。
3 Bufferable与catchable是什么？他们的作用？
     建议看“计算机体系架构”方面的书籍，会有很详细的介绍。
4 privileged access与secure access是什么？他们的作用？
     主要用于ARM处理器内部自己权限的管理。在普通应用中不用考虑。
5 semaphore type operations具体指什么类型操作？
     举个简单例子。摸个地址被写后，如果在被读之前，不希望被新的写覆盖掉。就可以用automic access.这个需要slave支持。普通应用中也不用考虑。
6 Byte-invariant看了协议一直没弄懂，最好是能举一个实际的例子？
     不清楚。没研究过。用于mixed-endian系统中。实际中一般不会出现，一般都是big-endian或little-endian.

myrrhy

65# 不再回头
The read data reordering depth is the number of addresses pending in the slave that can be reordered.

1.这个read data reordering depth到底是个什么概念？它的目的只是为了address的pending么？还是还有其他用途？
     data reordering depth与address pending是两个概念。这是由于AXI协议里数据和地址是分开控制的。这两个概念都要区分读和写，即读和写是分开控制的。下面以读为例：
     address pending number是指在传输的未被处理完的传输个数，比如你连续请求了4次不同的读操作，但是这4次读操作的数据都没有读完。这样address pending(或者outstanding address)数就是4.
     data reordering depth是指数据的乱序深度。以读为例，如果你要连着读4个地址，这4个地址是可以在数据没回来之前都发送到总线上去，如果data reordering depth = 1，这是个地址的数据回来的顺序必须按照地址发送出去的顺序回来。如果为4，则4个地址回来的数据都可以乱序回来，不必考虑地址发送出去的顺序。
2.Out-of-order这个功能跟这个read data reordering depth 有关么？
     一个概念
3.对于slave来说有没有outstanding的深度呢？
    有，所有的配置都是要master和slave支持的。
4.这个outstanding的深度跟read data reordering depth有什么关系么？
    参考1
5.另外，如果pending在这个slave的address都是来自于同一个master，而且是同样的id，由于需要保证返回数据的顺序性，这个顺序是由slave本身来保证，还是说它通过read data reordering depth或类似的fifo来对slaveip返回的数据进行重排序再返回给总线呢？
    同一id不能乱序。slave要保证

psong789

学习中