简单的LED实验失败....求助 啊啊啊

xiaoyunvsmm

请大神帮我看看啊

1. module led(
   
2.                                         clk,rstn,led);
   
3. 
   
4. input clk,rstn;
   
5. output led;
   
6. 
   
7. reg[11:0]count;
   
8. parameter T200MS = 12'd4095;
   
9. 
   
10. always@(posedge clk or negedge rstn)
    
11.         if(!rstn)
    
12.                 count <= 12'd0;
    
13.                 else if(count==T200MS)
    
14.                 count <= 12'd0;
    
15.                 else
    
16.                 count <= count + 1'b1;
    
17.                
    
18. assign led = ((count>12'd2048)&&(count<=T200MS))?1'b1:1'b0;
    
19. 
    
20. endmodule
    

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wrhwindboy

大哥怎么失败了？你的时钟是不是太快了？

xiaoyunvsmm

是滴，后来发现是时钟太快了。。。谢谢啊