面试被问到：布局布线后有setup和hold violation如何解决。

cqu2ustc · 发表于 2012-11-6 23:01:35

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面试被问到：布局布线后有setup和hold violation有多少方法可以解决。答得不好。请大家指点

陈涛 · 发表于 2012-11-6 23:15:43

答得不好是正常的，因为问题问得太没水平

xjg@hmes · 发表于 2012-11-7 08:39:39

因素太多了

damonzhao · 发表于 2012-11-7 09:39:34

问的太泛泛了，从前到后都可能找出原因来

arsenal1215 · 发表于 2012-11-7 15:35:29

有大神能全面的探讨分析下吗

cqu2ustc · 发表于 2012-11-7 23:40:22

问道的是布线后 STA发现violation了，如何修？
我就答了IPO，ECO之类的。就没说重新回去PR。

mwc1979 · 发表于 2012-11-8 17:10:09

正常来讲STA中报的Violation和EDI中报的不太一样，STA中抱出来的Violation你首先要看你再EDI中是不是也有这个Path，如果有的话从location，Cell type 等方面发现有修改的空间的话就在修一遍，如果没有就可以要求电路设计人员修改电路结构！或者说Margin 足够的话不修也是可以的！
STA中的Violation 不见得都要修掉

liu2703 · 发表于 2012-11-8 21:53:43

感觉这样问不好，毕竟引起setup/hold的因素很多，而且解决方法也是多种多样！或者就说具体情况具体分析吧，呵呵！

sunxeu · 发表于 2017-2-13 13:25:17

回复 7# mwc1979

为什么STA中的violation不见得都要修掉？不是要时序收敛的吗？不修掉怎么收敛？为什么要到EDI中去找violation的path线是否存在，什么情况下可能不存在呢？

后端实习生，希望可以详细的回答，谢谢。

jingest · 发表于 2017-2-15 09:43:31

回复 mwc1979

为什么STA中的violation不见得都要修掉？不是要时序收敛的吗？不修掉怎么收敛？ ...
sunxeu 发表于 2017-2-13 13:25

登录/注册后可看大图

我猜是因为要看看是不是真正的timing violation，是否constraint下的有问题，或者漏设false path之类的，或者是否design本身有问题，确定各种因素都是正确的之后再开始着手修timing。至于具体如何修，这个也没啥好说的，PR的基本功了。

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