晶振 PLL

Tonyhai · 发表于 2012-10-25 22:41:33

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晶振到PLL的这段path有什么特殊要求吗
需要注意是地方多谢

icfbicfb · 发表于 2012-10-26 21:32:48

尽量短，尽量加shield，

liu2703 · 发表于 2012-10-27 12:46:40

赞同icfbicfb版主，PLL锁定在稳定频率上，需要一个精准的参考频率值，保证OSC到PLL的path尽量短、干扰小就好

陈涛 · 发表于 2012-10-29 11:26:33

本帖最后由陈涛于 2012-10-29 11:29 编辑

PLL的place&route均要按照它的implementation guide进行

其中包括PLL到chipboundary的距离，power，signal net的连接方法（宽度，金属层，长度，是否可以跳层），周围隔开的空间，PLL到第一个cell的距离，loading

[原创] 晶振 PLL

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