SR-latch

sunyuanxin · 发表于 2012-8-10 18:59:14

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看书的时候遇到这个问题Develop a testbench and verify a gate-level model of an SR-latch，SR-latch是什么？

lightland · 发表于 2012-8-11 16:26:25

SR锁存器，==|||

ComTTest · 发表于 2012-8-17 02:25:24

一种方案

module rslatch (
input r, s, g, d,
output reg q
);

always @(r, s, g, d)
if (r) q = 1'b0;
else if (s) q = 1'b1;
else if (g) q = d;

endmodule

sjzdzzgc · 发表于 2012-8-17 08:37:48

learn,3q

sunyuanxin · 发表于 2012-8-31 10:35:29

r是啥信号？

meteoryzy · 发表于 2012-8-31 14:10:09

回复 5# sunyuanxin

r means reset

meteoryzy · 发表于 2012-8-31 14:11:39

回复 3# ComTTest

SRlatch好像没有D输入吧

ComTTest · 发表于 2012-8-31 18:20:51

回复 7# meteoryzy

你是对的，我错了，应该是这样

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