modelsim仿真问题

大大朱小小朱 · 发表于 2012-7-5 11:15:45

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为什么单独模块仿真输出没有问题，但是和其他模块一起仿真时输出数据就出错，是不是时序的问题啊？

qinjuanyan · 发表于 2012-7-5 11:50:23

很明显，你的模块没有和别的模块信号做好握手协议。设计一个模块简单，设计一个系统就难了。看看上层模块输出给你这个模块的信号有没有完全按照你的意愿给你啊。

大大朱小小朱 · 发表于 2012-7-5 21:36:59

回复 2# qinjuanyan

谢谢，请问写顶层模块时应该注意什么呢？本人初级~~

xujin2002ji · 发表于 2012-7-5 21:58:27

看每个模块接口上，每个时钟的波形就行了。

tigerjade · 发表于 2012-7-6 00:17:15

有可能是输入的时序不对。

brucelu104 · 发表于 2012-7-6 08:31:53

新手容易犯连线的错误

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