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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 暴多的verilog设计实例，均有原代码！！

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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

发表于 2007-4-6 15:38:36 | 显示全部楼层

太感谢了！！

太感谢了！！

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发表于 2007-4-6 16:07:44 | 显示全部楼层

不错！
顶一下！

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发表于 2007-4-6 16:08:54 | 显示全部楼层

呵呵！！！！！

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发表于 2007-4-6 21:04:08 | 显示全部楼层

谢谢！继续努力！

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发表于 2007-4-7 20:19:00 | 显示全部楼层

*** 作者被禁止或删除内容自动屏蔽 ***

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发表于 2007-4-7 21:27:13 | 显示全部楼层

好东东

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发表于 2007-4-8 19:14:13 | 显示全部楼层

:Q:Q:Q

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发表于 2007-4-8 19:15:24 | 显示全部楼层

fgghfdg

hao ,ding

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发表于 2007-4-8 23:02:27 | 显示全部楼层

dingyige

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发表于 2007-4-9 11:02:41 | 显示全部楼层

想问一下有没有PLL的资料？

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