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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 暴多的verilog设计实例，均有原代码！！
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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

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发表于 2009-7-9 05:24:01 | 显示全部楼层
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发表于 2009-7-9 05:35:28 | 显示全部楼层
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发表于 2009-7-9 05:36:58 | 显示全部楼层
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发表于 2009-7-9 05:48:38 | 显示全部楼层
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发表于 2009-7-13 11:04:11 | 显示全部楼层

先下来看看

先下来看看，楼主辛苦了
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发表于 2009-7-14 19:30:54 | 显示全部楼层
eetop
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发表于 2009-7-14 21:35:03 | 显示全部楼层
谢谢你了
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vobmzy
发表于 2009-7-15 19:12:14 | 显示全部楼层
hao  dx! dddddddddddddddddd
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发表于 2009-7-15 21:42:46 | 显示全部楼层
999999999999999999
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发表于 2009-7-15 21:44:59 | 显示全部楼层
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