数模混合版图LVS

magicalmuzhuzhu · 发表于 2012-3-28 17:39:07

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做的电路里有自己画的analog layout，也有用encounter做的然后导入virtuoso的digital layout。单独做digital part的lvs，用layout去比对spice netlist（从encounter导出的verilog netlist转换的来），结果是match的。

可是做整体数模混合的电路的lvs，似乎始终没有识别到那个digital的部分，include了digital的spice netlist也没有用。

麻烦有做过这个流程的朋友能指点一下应该怎么做数模混合的LVS？我用的是calibre。多谢了。

damonzhao · 发表于 2012-3-28 21:35:59

http://bbs.eetop.cn/viewthread.php?tid=321981&highlight=

magicalmuzhuzhu · 发表于 2012-3-29 00:05:42

回复 2# damonzhao

多谢版主回复。是不是可以把digital block当作一个top level的blackbox去处理，只管它的pin的连接？能否指点一下怎么在calibre lvs里实现这个功能呢？

damonzhao · 发表于 2012-3-29 09:30:51

本帖最后由 damonzhao 于 2012-3-29 09:35 编辑

回复 3# magicalmuzhuzhu

可以作为一个blackbox处理
但是最终的验证，建议取消掉blackbox的设定再进行。

关于设置的方法前面的帖子都讲到了。你看看下面的文档吧。

using_calbr_student_workshop.pdf (5.43 MB, 下载次数: 1111 )
希望你能成为验证专家

half_honey · 发表于 2012-3-29 10:03:43

哈哈收资料啦~~赞

half_honey · 发表于 2012-3-29 10:05:14

哈哈收资料啦~~赞的赞的~~~

magicalmuzhuzhu · 发表于 2012-3-29 10:27:05

回复 4# damonzhao

多谢版主提供资料，我先照着做一下看看。专家做不到阿，小学生而已。。。感觉有太多东西不会。之前做encounter，stream那些也是摸索了好久才搞定。

damonzhao · 发表于 2012-3-29 10:39:00

回复 7# magicalmuzhuzhu

慢慢积累吧！

自己探索理解的更深；别人直接告诉答案，往往只会一知半解，没有提高

magicalmuzhuzhu · 发表于 2012-3-29 13:16:34

回复 8# damonzhao

呵呵，但愿能积累出点门道来。那个blackbox已经解决通过lvs了。除了改rule file，在lvs option->include svrf command里面加上lvs box语句也可以有一样的效果。现在top level过了，我再研究下去掉box怎么处理。再次谢谢版主指点了哈。

damonzhao · 发表于 2012-3-29 13:39:58

回复 9# magicalmuzhuzhu

不客气，你学的厉害了，回头我再向你请教。

去掉LVS box的话，你要考虑修改网表了，上面的那个链接有这方面的信息，你可以仔细看看

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