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[求助] MOS栅源连接用作什么?

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发表于 2012-3-22 14:04:26 | 显示全部楼层 |阅读模式

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本帖最后由 zl8702 于 2012-3-23 15:58 编辑

最近遇到一个电路,电路中的PMOS栅源边在了一起,不知道是干什么的,求助,谢谢

电路图

电路图

仿真波形

仿真波形
发表于 2012-3-22 15:08:23 | 显示全部楼层
工作在饱和区的PMOS,这么连的大部分是用于作负载 I=Kp*(Vgs-Vth)^2. 小信号下可以认为是一个电阻。
发表于 2012-3-22 17:06:40 | 显示全部楼层
学习了!
发表于 2012-3-22 17:21:05 | 显示全部楼层
上面一个pmos,它的栅源连在一起,下面一个nmos,它的栅源又连在一起,电路里面还有一个电阻,这个结构是esd保护。我也是初学者,大家都不容易啊
发表于 2012-3-22 18:14:05 | 显示全部楼层
确实,如果是g,s连接,只在esd电路中看到
 楼主| 发表于 2012-3-23 15:53:29 | 显示全部楼层
多谢楼上几位,我觉得应该也是起电压保护作用的,但是电路又出现一个问题,就是开始时电压产生了一个负脉冲开启了,后来又有一个正脉冲判断,不知道这两个脉冲如何而来[img][img][img][/img][/img][/img]
 楼主| 发表于 2012-3-23 15:55:46 | 显示全部楼层
多谢楼上几位,我觉得应该也是起电压保护作用的,但是电路又出现一个问题,就是开始时电压产生了一个负脉冲开启了,后来又有一个正脉冲判断,不知道这两个脉冲如何而来[img][img][img][/img][/img][/img]
发表于 2012-3-23 18:17:44 | 显示全部楼层
tie low啊, gate 不希望直接到地
发表于 2012-3-24 22:31:25 | 显示全部楼层
确实是tie low,产生一个低电平。
发表于 2012-3-25 22:29:59 | 显示全部楼层
回复 9# amodaman


    tie low 是什么意思啊
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