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[求助] 求高手指教!关于运放的电源电压抑制比问题!

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发表于 2012-3-16 12:18:30 | 显示全部楼层 |阅读模式

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一个普通的二级运放,如下图。作为嵌位用。闭环增益在80多dB。但是仿真电源电压抑制比的时候感觉低频够了,但是高频下抑制比太小了。有什么办法能够提高高频下的电源电压抑制比。
QQ截图20120316121008.jpg QQ截图20120316121113.jpg
发表于 2012-3-16 12:25:57 | 显示全部楼层
PSRR左端是运放增益撑着,右端是靠的输出管子等效电阻相关的gds及cgs,cgd及负载电容的RC网络决定的。改改第二级。负载要带上的啊。
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发表于 2012-3-16 12:52:43 | 显示全部楼层
http://bbs.eetop.cn/thread-323176-1-1.html
旁边这个帖子有模型。看看吧
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 楼主| 发表于 2012-3-16 13:12:26 | 显示全部楼层
回复 2# chenkai_kk


    谢谢!不好意思啊,可能我的表述出问题了,我的真实意思是抑制比这条线上升得太快了,到1MHz的时候已经很小了。不是指高频端太小,我只想在1MHz的时候也能有比较大的抑制比,再高的平率就无所谓了。
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发表于 2012-3-16 14:43:44 | 显示全部楼层
那条曲线是增益的下降曲线,20dB/频程。不可能改好。
你唯一可以考虑的是把右边的PSRR做好,让左边和右边的PSRR高的区域尽量重合。
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 楼主| 发表于 2012-3-16 14:56:13 | 显示全部楼层
回复 5# chenkai_kk


    恩,谢谢!我再改改。
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发表于 2012-3-16 20:12:20 | 显示全部楼层
回复 1# hfutmjj26


   把差分对的Bulk接到源极呗。
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发表于 2012-3-17 21:08:58 | 显示全部楼层
推大-3DB带宽,同时尽量保持高增益,很难,不过你这个还能提高
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发表于 2012-3-17 21:13:08 | 显示全部楼层
提高差分对管的电流,增加单位增益带宽,准行﹣如果不可惜功耗的话。
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发表于 2012-3-17 21:43:39 | 显示全部楼层
想办法增大带宽。不过,1M处的不通过加RC滤波是很难有很高的psrr的。
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