直接产生verilog的testbench的python脚本

colindeng · 发表于 2021-4-18 23:53:58

谢谢分享…

ln87213 · 发表于 2021-4-19 01:04:31

学习了

xxl04120184 · 发表于 2021-6-17 15:21:04

牛逼

hydroa · 发表于 2021-7-27 22:47:44

谢谢

wjq1999 · 发表于 2021-7-28 12:41:04

下载来学习学习

jackhb007 · 发表于 2021-7-29 14:00:09

look look

lglglg · 发表于 2021-8-12 12:38:55

非常感谢

joshuaxue · 发表于 2021-8-17 14:13:27

thanks a lot

sysclock · 发表于 2021-9-11 16:24:46

vTbgenerator.py ModuleFileName.v | tee tb.v

njyxq · 发表于 2021-12-16 16:37:14

C:\Users\stars>python3 D:\python\eetop.cn_vTbgenerator\vTbgenerator.py jtag_seq_tb.v Traceback (most recent call last): File "D:\python\eetop.cn_vTbgenerator\vTbgenerator.py", line 213, in <module> writeTestBench(sys.argv[1]) File "D:\python\eetop.cn_vTbgenerator\vTbgenerator.py", line 144, in writeTestBench inFile = open(input_file) FileNotFoundError: [Errno 2] No such file or directory: 'jtag_seq_tb.v'

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