formality后出现Loop的问题该怎么fix阿～～求助～～

michaelll · 发表于 2012-2-3 10:45:57

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在跑完formality后有22条aborted的问题，如下：
----------------------------------------------------------------------------------------
Matched Compare Points    BBPin Loop BBNet    Cut Port    DFF    LAT TOTAL
----------------------------------------------------------------------------------------
Passing (equivalent)       1116             0    0       0    877  111938    504  114435
Failing (not equivalent)    0                0    0       0       0       0          0    0
Aborted
  Loop  (cycle-driven)       0                   0    0       0       0       22       0    22
****************************************************************************************
请问这个Loop的问题该怎么修阿在formality中？用什么命令呢？
谢谢，大家帮帮忙阿！！

michaelll · 发表于 2012-2-3 13:49:33

顶～～大神来帮忙拉～～

michaelll · 发表于 2012-2-3 22:29:40

没有人回答吗~~~~

michaelll · 发表于 2012-2-5 10:42:47

来个人帮帮忙~

strivenbu · 发表于 2012-2-6 10:52:10

来个人回答把我也想知道这个loop是怎么回事？

热水加冰 · 发表于 2012-10-28 14:50:28

我也想知道啊遇到了这个问题

pv811_len · 发表于 2013-1-4 16:57:20

我也遇到过，可能是一些black box内部检查不到引起的
流片后芯片也能正常工作

yic2000 · 发表于 2013-1-5 12:02:15

遇到过...
貌似是你网表他不认大小写~
比如N9和n9，你网表里面其实是2个东西，但软件他不认，把N9也当n9了，然后就出现loop了~
好像是这样的，记不清了~

fhy420462303 · 发表于 2018-12-22 16:14:36

怎么解决的呀

yuzp · 发表于 2021-4-10 09:30:22

请问解决了么？

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