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楼主: cxl666

IC6151破解版32/64bit

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发表于 2018-9-12 12:52:38 | 显示全部楼层
当en_in时,启动auto的信号
相关性,设置为I,可以同时启用所有8个阶段
因为管道的所有寄存器都被锁存在0,这将是
不影响滞后的结果
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发表于 2018-9-12 12:53:56 | 显示全部楼层
。 但是如果en_in设置为0,那么
意味着要停止,所有8个阶段都要按顺序禁用
方法使得每个阶段的管道中的所需数据是
一个接一个地完全倾倒。
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发表于 2018-9-12 12:55:25 | 显示全部楼层
该过程在中进行了演示
图4,其中en_in适当地延迟到每个阶段,直到全部
其阶段管道中的有用数据被“用完”。
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发表于 2018-9-12 12:57:36 | 显示全部楼层
用于36滞后相关器的VHDL代码程序结构
包括测试台程序的系统如图5所示。
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发表于 2018-9-12 12:59:03 | 显示全部楼层
MTC36_system.vhd是36滞后的主要程序
相关器,包含I MTC8 _core组件(ic 1)和
7个MTC4 _核心组件(ic2到ic8)。 Ram.vhd是64
位宽存储器存储36个滞后,36个“intf”和36个
“intp”数据集和数据中的Feed总数及其数量
从相关器获得的总和。
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发表于 2018-9-12 13:02:55 | 显示全部楼层
数据类型和
VHDL代码的组件在包文件中定义
cor-'package。VHD。
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发表于 2018-9-12 14:11:18 | 显示全部楼层
MTC8 _core.vhd定义了有限级机器(FSM)
和图8所示的8滞后相关器的流水线电路。
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发表于 2018-9-12 14:13:55 | 显示全部楼层

MTC4 _core.vhd定义了所示的4滞后相关器的电路
在图3中.MTC_all_coreJeadout.vhd链接模型
“MTC36_system.vhd”和“Ram.vhd”在一起。
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发表于 2018-9-12 14:16:14 | 显示全部楼层
Test_bench_mem.vhd是测试平台程序
MTC所有核心readout.vhd供给刺激
MTC_all_core读出模块并加载对称
方程所需的归一化自相关函数数据
3从Ram.vhd到外部文本文件。
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发表于 2018-9-12 14:17:16 | 显示全部楼层
更多细节将是
详细阐述了下一节。
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