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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 基于Verilog HDL的异步FIFO设计与实现
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楼主: tangerui

基于Verilog HDL的异步FIFO设计与实现

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baolin
发表于 2007-12-13 14:29:31 | 显示全部楼层
thanks for sharing!
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yshgcs
发表于 2007-12-17 20:47:14 | 显示全部楼层
我下载我回复我学习
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发表于 2007-12-19 09:19:53 | 显示全部楼层
我正在找呢，谢谢！看一下先
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huavxpxp
发表于 2008-3-4 21:50:15 | 显示全部楼层
码的 ，期刊上的
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sme
发表于 2008-3-4 22:01:40 | 显示全部楼层

谢谢

xiexie,好东西啊
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sme
发表于 2008-3-4 22:03:59 | 显示全部楼层

thanks

我看过了，的确是好东西
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tman001
发表于 2008-6-26 14:35:50 | 显示全部楼层
Thanks!
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九江小邱
头像被屏蔽
发表于 2008-8-31 23:00:33 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
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发表于 2008-9-1 13:13:16 | 显示全部楼层
ok
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发表于 2009-3-23 10:36:31 | 显示全部楼层
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