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[求助] 怎么区分RTL级建模和行为级建模

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发表于 2011-10-18 10:26:19 | 显示全部楼层 |阅读模式

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本人verilog新手,想请教两者的区别
发表于 2011-10-18 11:27:01 | 显示全部楼层
前者主要用于设计,可综合。
后者主要用于仿真验证,不可综合。
发表于 2011-10-18 13:29:56 | 显示全部楼层
呵呵,二楼正解!
发表于 2011-10-18 17:29:44 | 显示全部楼层
mark~
发表于 2011-10-18 17:31:26 | 显示全部楼层
rtl级--寄存器级,可综合
行为级更像是c语言
发表于 2011-10-18 22:20:11 | 显示全部楼层
呵呵,我想对于新手这样的解释似乎起不到解释的作用
发表于 2011-10-18 23:45:06 | 显示全部楼层
行为级描述的是电路的功能行为,RTL级描述电路的数据流
发表于 2011-10-19 08:33:45 | 显示全部楼层
RTL 设计
behavior 验证,有时候也可用于设计
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