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[讨论] 跨时钟域设计、验证

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发表于 2011-10-2 19:27:33 | 显示全部楼层 |阅读模式

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本帖最后由 never_lazy 于 2011-10-17 07:26 编辑

1、场景
一个SOC系统,如果有2个时钟源,分别经过时钟门控、时钟分频后给到各模块,作为他们的时钟输入。系统工作时会涉及到跨时钟域的切换,需做一些时钟同步处理!
2、目前我的方法
方法1:Review同步处理机制的RTL代码、结合LEDA或nAnalysis工具分析;
方法2:结合Synopsis提供的DesignWare IP解决方法,将设计验证结合为一体综合考虑,详见《跨时钟域信号同步解决方案》。
以上两种方法,都不是特别好。
3、问题
对这种场景的跨时钟域设计、验证,大家有什么高见?希望能提高验证效率,同时确保设计、验证质量。

Timing Verification of Application-Specific Integrated Circuits.pdf

14.72 MB, 下载次数: 302 , 下载积分: 资产 -5 信元, 下载支出 5 信元

发表于 2011-10-6 10:56:51 | 显示全部楼层
这个问题发在讨论区会更多高手解决?期待高手!
发表于 2014-7-17 16:51:27 | 显示全部楼层
期待高手的回复,看过论坛里,多是考虑如何设计的,说验证的还真不多
发表于 2014-7-23 10:26:06 | 显示全部楼层
下来看看
发表于 2014-7-24 09:02:46 | 显示全部楼层
頂一下!感謝大大無私分享
发表于 2014-7-24 13:41:29 | 显示全部楼层
跨时钟域验证,看一下,以前见过很多跨时钟域的设计。
发表于 2015-1-12 17:25:53 | 显示全部楼层
1、review方案与代码;(这里可能在后续的几步都需要重复进行)
2、可以的话可以使用spyglass试试;
3、综合后看看report 那些没有约束的路径;
4、sta分析时序。
发表于 2015-8-7 08:51:30 | 显示全部楼层
书不错。。。。
发表于 2015-8-25 22:50:22 | 显示全部楼层
谢谢楼主分享
发表于 2016-1-27 10:17:39 | 显示全部楼层
very good ,download and have a look ,thanks !
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