如何把数字库的信息拿到virtuoso里面用

lizhaohong520@ · 发表于 2011-8-3 22:41:53

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本帖最后由 lizhaohong520@ 于 2012-3-2 14:15 编辑

大家好，我有一个数字std_cell 库，但是我想自己用virtuoso搭电路，这样对电路的理解深刻一些，
我数字库有以下文件

std_cellneir

，我意思是怎么才能把std_cell 里面cell的电路原理图和版图在virtuoso中直接可以调用。这样我就不不要画每一个cell单元的电路原理图和版图，还有像以下D触发器有很多形式，用DC和ICC这两个工具你都不知道其内部晶体管级和逻辑单元是怎么搭的。

icfbicfb · 发表于 2011-8-4 11:25:07

gds2 可以stream in icfb 形成layout view，就能看了
schematic view 就不一样了，要有pdk啥的，比较麻烦，在icfb里面叫composer来打开的，
tsmc叫cdk吧，

toad · 发表于 2011-8-4 18:08:03

cdlin吧

lizhaohong520@ · 发表于 2011-8-5 12:28:06

回复 2# icfbicfb 可以回复具体点？

lizhaohong520@ · 发表于 2011-8-5 12:29:08

回复 3# toad

？什么意思？

tiger_lein · 发表于 2011-8-6 22:34:05

把你的gds数据stream in cadence CIW平台，一般情况下工艺所给的gds数据包含PDK（process design kit）信息，PDK库中就会包含symbo、layout、cdl 等等信息，就可以完成你上面描述的功能；没有可以根据cadence工具给出的基础库来自己建立PDK库，比较麻烦准确性欠缺；

zhouchong0904 · 发表于 2011-8-8 14:37:47

我试过把cdl网表直接导进去，很麻烦。而且导成功了后你会发现出来的schmatic很乱。我后来就直接看layout了，然后再反推出它的schmatic。

icfbicfb · 发表于 2011-8-8 14:58:03

一般是有个cdk的， complete design kit，
专门给composer用的，

版图多了，翻电路比较累，

lizhaohong520@ · 发表于 2011-8-9 19:42:02

回复 6# tiger_lein

CDL有网标文件，你可以写出了，gds文件可以生成layout！我是这样的，假如你有lib就更好！呵呵！

zhangds · 发表于 2011-8-13 20:18:28

thanks for your answer

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