关于DC的面积优化

chengroc · 发表于 2011-7-28 20:56:07

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如果是单独综合RTL模块，面积约7600多门
但如果做一个top层，例化RTL模块和一个MEMORY IP，综合此top层，RTL模块的面积达到9000门

什么原因导致综合优化效果变差了呢？

xiaocanmeng · 发表于 2011-7-29 00:40:36

直接综合TOP层，会不会工具多加了BUF？

xcb2002 · 发表于 2011-7-29 21:49:26

你这个模块所处的“环境”不一样了，DC根据不同“环境”进行优化的结果

ghost_ic · 发表于 2011-8-1 21:42:06

同问？！！！！

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