怎么解决电压“过冲”或者“下冲”现象？

云中鹤叉 · 发表于 2011-5-31 15:14:48

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一个反相器进行仿真，在时钟沿处总是出现“过冲”或者“下冲”现象，请问如何解决？

xiaowanzi88 · 发表于 2011-5-31 15:21:45

使用Deglith电路消除过冲和下冲情况，通常有两种办法对数字电路做调整，其一采用简单RC滤波器，但是消耗一定的面积，其二采用D触发器对上升沿采样，消除glitch.对于开关管的下冲现象，由于开关管面积很大，寄生效应突出，下冲可能出发latchup发生，考虑使用过零检测电路，及时关断开关管。

limper · 发表于 2011-5-31 16:27:05

加大loading，增大输入信号的rising/falling time

widlarfan · 发表于 2011-6-1 01:23:22

Why do you care about overshoot in your applications?

fuyibin · 发表于 2011-6-1 09:30:20

一个反相器进行仿真，在时钟沿处总是出现“过冲”或者“下冲”现象，请问如何解决？
云中鹤叉发表于 2011-5-31 15:14

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吃饱了撑的，纯粹dan teng

kaikanertan · 发表于 2013-4-8 09:26:24

回复 5# fuyibin

是么？这个问题就没点意义了？多说点儿有营养的话吧~

loopgain · 发表于 2013-4-8 10:13:09

Reduce slew rate.

jiang_shuguo · 发表于 2013-4-8 10:32:57

回复 5# fuyibin

我觉得这个问题有意义，例如leading blank 就是解决这个问题而产生的技术。若你接触的电路都不care这个，那就无所谓了。

pigintree · 发表于 2013-11-1 10:13:24

回复 5# fuyibin

不用考虑latch-up吗？

hszgl · 发表于 2013-11-1 10:42:39

回复 9# pigintree

如果要认真考虑起来，就要关注过冲幅度，过冲脉宽等等。如果强度和脉宽时间都不够载流子运动的，何必考虑？

其次，很多现象都只是仿真时的现象而已。在考虑到寄生电阻电容等效应后，自然就会消除。

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