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楼主: liulangshusheng

[资料] 32位除法器设计Verilog代码

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zixuan1982
发表于 2012-9-7 10:13:32 | 显示全部楼层
回复 1# liulangshusheng

缺少inverse这个子模块吧？怎么使用啊？！
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duan_dzj
发表于 2012-9-7 14:57:25 | 显示全部楼层
学习。学习。
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befrank
发表于 2012-9-11 21:59:57 | 显示全部楼层
非常感谢分享哈
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husthuige
发表于 2012-11-5 11:07:13 | 显示全部楼层
多谢分享
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hclin
发表于 2012-11-5 13:44:14 | 显示全部楼层
good job !!!
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shcet
发表于 2012-11-6 15:28:35 | 显示全部楼层
谢谢分享，下来看看
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hbwlh01
发表于 2012-11-7 21:07:16 | 显示全部楼层
学习借鉴一下~
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14072083
发表于 2012-12-16 11:41:48 | 显示全部楼层
多谢分享  thanks！！！！
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wx371793214
发表于 2012-12-16 12:44:56 | 显示全部楼层
顶顶顶顶顶顶顶
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发表于 2013-1-13 14:47:19 | 显示全部楼层
谢谢楼主分享
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