PLL学习历程—敬请高手指点

maitanium · 发表于 2011-5-24 19:42:24

謝謝分想~~~~

wyhgod · 发表于 2011-7-5 23:15:15

顶起！

fthaha · 发表于 2011-7-6 11:24:36

xuexi

shikaicool · 发表于 2011-7-6 13:28:24

thank you

hunu_zyf · 发表于 2011-8-7 23:22:05

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hunu_zyf · 发表于 2011-8-7 23:28:29

有一个问题想问高手，用SDM时，它的输出决定分频比，那么如果我的参考频率为12MHz， VCO频率为480MHz, 带宽为120KHz，分频比改变一下PLL要10us才可以重新锁定，但是SDM的变化速度是12MHz，是不是说PLL瞬间相应不过来，通过滤波器降SDM的平均数给锁定下来了？？？

doedr · 发表于 2011-8-11 03:37:01

怎么没看到啊？

ramona · 发表于 2011-8-12 15:45:51

谢谢分享

markhwa2 · 发表于 2011-8-12 15:50:55

谢谢分享

xuw188 · 发表于 2011-8-13 12:56:36

顶楼主

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