如何处理LVS验证通过之后的警告

随风奔跑 · 发表于 2010-9-9 22:41:34

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首先在LVS Options中有选择ERC验证。LVS验证没有出错的Result，但是Output Files中有一个Extraction Report前面加了感叹号，Report里面主要有两个警告：
short circuit : different names on one net
open circuit : same name on different nets
需要修改，一般情况short circuit时候将连线中其中一个名字text删掉；open circuit时候将不同连线上相同名字改成其他的。
然后顶层单元重新Run LVS没有警告，但这样会改变电路逻辑功能吗？还有没有其它修改方案呢？
谢谢

随风奔跑 · 发表于 2010-9-9 22:43:33

总之验证碰到很多棘手的问题。。。

随风奔跑 · 发表于 2010-9-10 11:51:39

纠结~

小小强 · 发表于 2018-1-12 09:47:06

请教一下：为什么我打VDD与VSS的Label，明明在两条不同的线上，还是说我short circuit呢

上官轩晖 · 发表于 2018-7-12 14:36:09

回复 4# 小小强

请问您解决这个问题了吗？

liang_song · 发表于 2022-11-9 11:46:51

请问这个问题有啥解决方案吗？，遇到了
open circuit : same name on different nets

liang_song · 发表于 2022-11-9 11:55:15

找到了
LVS Options->Connect->勾上Connect nets with colon(

，同时Connect nets named: Net名

夏季冰可乐 · 发表于 2022-11-11 09:09:06

Lvs是OK的话，Short 一般都是底层模块的pin不一样，到top层合入了

夏季冰可乐 · 发表于 2022-11-11 09:11:08

open则是开了虚拟连接，通常是底层模块连线不方便就打了多个pin，到上一层再合入，当前层就会报open警告⚠️

缥渺星尘 · 发表于 2022-11-30 14:06:53

谢谢分享

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