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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › How to use Perl in your SystemVerilog Design Flow
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楼主: chxibin

[资料] How to use Perl in your SystemVerilog Design Flow

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wqy1985
发表于 2011-1-27 22:05:49 | 显示全部楼层
这玩意儿还真是有意思的哦
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scorpion
发表于 2011-1-27 22:51:56 | 显示全部楼层
thanks a lot
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hi_johnson
发表于 2011-1-28 10:47:32 | 显示全部楼层
kankan
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nishuiqiqiu
发表于 2011-2-2 14:31:38 | 显示全部楼层
定起来。。。。。。。。。。。。
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hustsc
发表于 2011-2-4 23:23:55 | 显示全部楼层
多谢分享
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gticc
发表于 2011-2-7 21:13:19 | 显示全部楼层
下载看看啊
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izh18
发表于 2011-2-14 11:10:32 | 显示全部楼层
瞧瞧！
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mfsgsb1987
发表于 2013-10-21 15:22:59 | 显示全部楼层
楼主高人，tks
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mzsm1
发表于 2013-10-21 15:34:27 | 显示全部楼层
文件很小啊
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airaing
发表于 2013-10-22 20:53:00 | 显示全部楼层
支持一下
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