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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › How to use Perl in your SystemVerilog Design Flow
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楼主: chxibin

[资料] How to use Perl in your SystemVerilog Design Flow

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wansanping
发表于 2010-10-25 20:06:10 | 显示全部楼层
谢谢楼主分享！
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gaconht
发表于 2010-10-26 02:52:45 | 显示全部楼层
thank so much
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xiaoming0751
发表于 2010-10-28 17:35:16 | 显示全部楼层
thank you\
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flyxiangshan
发表于 2010-10-29 17:05:50 | 显示全部楼层
thank you!
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ic_qiand
发表于 2010-10-29 19:29:13 | 显示全部楼层
perl 好东西啊！
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wangxuede220
发表于 2010-11-3 21:51:14 | 显示全部楼层
顶下，看看！
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nslnsl
发表于 2010-11-13 13:32:29 | 显示全部楼层
不错，谢谢！！！
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billwaston
发表于 2010-12-6 10:18:28 | 显示全部楼层
谢谢分享
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StevenD
发表于 2010-12-7 13:21:19 | 显示全部楼层
好东西, 謝樓主~~
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tbb2009
发表于 2010-12-12 13:27:44 | 显示全部楼层
感谢分享资料
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